Этапы развития ЭВМ

Содержание

 

1.Введение

  В данном  реферате кратко описывается  линейка процессоров фирмы Intel.  Анализируется модельный ряд, начиная с процессоров Intel Pentium I заканчивая самым новым процессором - Intel Pentium 4 Extreme Edition с технологией Hyper-Threading , совсем “древние” процессоры (Intel386, Intel486) фирмы Intel рассматриваться не будут, так же небудут описаны процессоры

  Анализ будет  полный по основным аспектам технических решений, тонкости затронуты не будут. Будут описаны: минимальная и максимальная тактовая частота, минимальный литографический размер (МЛР), набор микросхем (chipset), набор команд, частота ядра, КЭШ-память, оперативная память, частота поддерживаемой системной шины, типы корпусов, технологии связанные с процессорами и т.д.

 

  

2. Кратка справка процессоров Intel

   Процессор  Pentium фирмы Intel объединяет в себе  высокую производительность с  гибкостью и совместимостью, характеризующими платформу персонального компьютера. В настоящее время процессор Pentium является основой большинства продаваемых ПК и обеспечивает широкие возможности для работы с новым поколением мультимедийного программного обеспечения и Internet. Это способствует созданию новейшего программного обеспечения с мощной реалистичной графикой и возможностью воспроизведения полноэкранного видео. Процессоры Pentium расширяют диапазон микропроцессоров архитектуры Intel до новых вершин, создавая новую область возможностей для компьютерных систем сегодня и в будущем.

 

3. Intel Pentium I, MMX, PRO

Intel Pentium I

    Выпущен в 1993 г. Разрядность шины адреса – 32 бита, таким образом, максимальный размер адресуемой памяти равен 4 Гб. Разрядность шины данных – 64 бита.

Процессоры семейства Pentium I производятся с использованием полупроводниковой технологии и имеют размер элемента разрешения меньше микрона. Процессоры Pentium 75МГц, 90МГц, 100МГц и 120МГц выполнены по 0.6-микронной 3.3V технологии, а процессоры Pentium 120МГц, 133МГц, 150МГц, 166МГц и 200МГц - по 0.35-микронной 3.3V технологии.

    Процессоры  Pentium I включают в себя:

    Суперскалярная  архитектура – два параллельно  работающих конвейера обработки  позволяют одновременно обрабатывать до двух инструкций за такт. Конвейеры  носят названия U и V. U-конвейер (U-pipeline) – это АЛУ с полным набором инструкций, он может исполнять все целочисленные инструкции и инструкции с плавающей точкой. V-конвейер (V-pipeline) – АЛУ с ограниченным набором инструкций, может исполнять только простые (выполняемые за один такт – MOV, INC, DEC и т.п.) инструкции – черты RISC-архитектуры.

    На  кристалле интегрирован ассоциативный  кэш первого уровня – L1 размером 16К, который включает в себя раздельные кэши команд и данных (по 8К для команд и для данных). Кэш может быть сконфигурирован как WT (write-trough) – со сквозной записью либо с обратной записью –WB (write-back). Вкратце алгоритм работы WT и WB выглядят так: при сквозной записи (write-through) каждая операция записи одновременно выполняется и в строку кэша, и в ОЗУ. При этом, ЦП при каждой операции записи вынужден ждать окончания относительно долгой записи в ОЗУ. Алгоритм  WB (обратная запись) позволяет уменьшить количество операций записи на шине основной памяти. Если блок памяти, в который должна производиться запись отображён и в кэше, то физическая запись сначала будет воспроизведена в эту действительную строку кэша, и она будет отмечена как грязная (dirty) или модифицированная, т.е. требующая выгрузки в ОЗУ. Только после этой выгрузки строка станет чистой (clean) и её можно будет использвать для кэширования других блоков без потери целостности данных. В ОЗУ данные переписываются только целой строкой.

    Каждый  из кэшей включает в себя строки длиной 32 байта и содержит буфер  TLB – буфер преобразования линейных адресов в физические. Кэш поддерживает протокол MESI, названный по определяемым им состояниям: Modified, Exclusive, Shared и Invalid.

    M-state – строка присутствует только в одном кэше и она модифицирована. Доступ к этой строке возможен без регенерации внешнего цикла (по отношению к локальной шине).

    E-state - строка присутствует только в одном кэше, но она не модифицирована. Доступ к этой строке возможен без регенерации внешнего цикла. При записи в неё она перейдёт в состояние “M”.

    S-state – строка может присутствовать в нескольких кэшах. Её чтение возможно без регенерации внешнего цикла, а запись в неё должна сопровождаться сквозной записью в ОЗУ, что повлечёт за собой аннулирование соответствующих строк в других кэшах.

    I-state – строка отсутствуует в кэше, её чтение может привести к генерации цикла заполнения строки. Запись в неё будет сквозной и выйдет на внешнюю шину.

    Процессор имеет встроенный усовершенствованный  блок вычисления с плавающей точкой. Быстрые алгоритмы полностью  переработанного со времён 487-сопроцессоров FPU обеспечивают более чем десятикратное увеличение скорости при работе с основными операциями, включающими ADD, MUL, LOAD и т.п. по сравнению с 487. Конвейерная организация позволяет обрабатывать две целочисленные операции и одну (а при определённых условиях и две) операцию с плавающей точкой за такт.

    Применена технология динамического предсказания ветвлений, для этого введены  два буфера предвыборки.

    Введена возможность оперирования страницами размером 4 Мб в режиме страничной переадресации.

    Введено расширение архитектуры (относительно базовой архитектуры 32-х разрядных  МП) – добавлены новые регистры и команды. Сюда входит, например, инструкция CPUID, позволяющая в любой момент времени получить сведения о классе, модели и архитектурных особенностях данного ЦП. К расширению также относятся и регистры, специфические для модели, их можно разделить на 3 группы:

• тестовые регистры TR1...TR12. Они позволяют управлять большинством функциональных узлов ЦП, обеспечивая возможность тестирования их работоспособности: с помощью битов регистра TR12 можно запретить новые архитектурные свойства (предскизиние и трассировку ветвлений, параллельное выполнение инструкций), а также работу кэша L1.
• средства мониторинга произволительности . Сюда входят таймер реального времени (TSC) – 64 битный счётчик, работающий на инкремент с каждым тактом ядра ЦП, для его чтения предназначена команда RDTSC; счётчики событий CTR0 и CTR1 – оба разрядностью 40 бит, программируются на подсчёт событий различных классов, связанных с шинными операциями, исполнением инструкций, работой конвейеров, кэша и т.п.
• регистры-фиксаторы адреса и данных цикла, вызвавшего срабатывание контроля машинной ошибки.

    Применено выявление ошибок внутренних устройств (внутренний контроль паритета) и внешнего интерфейса шины, контроль паритета шины адреса.

    В состав чипа введён APIC (Advanced Programmable Interrupt Controller) – расширенный программируемый контроллер прерываний.

    Реализована возможность построения многопроцессорных (максимальное количестно ЦП – 2 штуки) систем двух типов: SMP – синхронная многопроцессорная обработка, и FRC – функционально избыточная система.

    Режим SMP (поддерживают процессоры Pentium начиная со второго поколения – Pentium 75 и далее). Каждый ЦП выполняет свою задачу, порученную ему операционной системой (Novell NetWare, OS/2, Windows NT, UNIX). При этом оба ЦП разделяют общие ресурсы компьютера, включая память и внешние устройства. В каждый момент времени шиной может управлять только один процессор из двух, по определённым правилам они меняются ролями. Для обработки аппаратных прерываний традиционные аппаратные средства становятся непригодными, так как пежняя схема подачи запроса INTR и передачи вектора в цикле INTA# ориентирована на единственность ЦП. Для решения этой задачи в структуру Pentium начиная со второго поколения был включён APIC. Этот контроллер имеет внешние сигналы локальных прерываний (LINT) и трёхпроводную интерфейсную шину, по которой оба процессора связываются с контроллером перываний на системной плате. Запросы локальных прерываний обслуживает процессор, на выводы которого поступают их сигналы; общие (разделяемые) прерывания приходят к процессорам в виде сообщений по интерфейсу APIC. Таким образом, контроллеры APIC каждого из процессоров и контроллер прерываний на системной плате, связанные интерфейсом APIC выполняют маршрутизацию прерываний.

    В режиме FRC оба процессора (один – Master, второй – Checker) выступают как один логический. Основной процессор (Master) работает в обычном однопроцессорном режиме. Проверяющий (Checker) выполняет все те же операции вхолостую, не управляя шиной, и сравнивает выходные сигналы основного с теми, которые генерирует он сам. В случае обнаружения расхождения вырабатывается сигналл ошибки IERR, который может обрабатываться как прерывание.

    При построении многопроцессорной системы  можно использовать поцессоры разного  степпинга, но частоты ядра должны совпадать (шина синхронизируется общим сигналом). 
 

Pentium MMX

    В 1996 году Intel разработала процессор с новым расширением, ориентированным на применение в мультимедиа, 2D и 3D графику. Итак, P55C это:

    Увеличенные кэши команд и данных – по 16К каждый.

    Расширенная CMOS (E-CMOS) технология позволила расположить  на кристалле 4.5 миллионов транзисторов.

    Увеличено количество ступеней конвейера.

    Улучшен способ предсказания ветвлений (он был  позаимствован у Pentium PRO).

    Количество  буферов записи увеличено вдвое, их теперь четыре.

    Для мультипроцессорной системы реализован только режим SMP, FRC исключён.

    И, наконец, самое интересное! На кристалле расположен новый блок – блок MMX (Multi Media Extention), который позволяет обрабатывать целочисленные данные (определённого типа – нового) методом SIMD (Single Instruction Multiple Data) – одна инструкция параллельно обрабатывает несколько данных. Для реализации блока MMX были введены:

    восемь  дополнительных 64-битных регистра (ММ0...ММ7)

четыре новых  целочисленных типа данных. Регистры MMX могут содержать упакованные 64-битные типы данных – упакованные байты, упакованные слова, упакованные даойные слова и квадро-слова.

    57 новых инструкций для одновременной  обработки нескольких единиц  данных одновременно.

    На  самом деле, регистры MMX физически расположены в стеке регистров FPU, так что новых регистров этот процессор не предоставляет, и чередование использования программой инструкций FPU и MMX приводит к снижению эффективности работы, связанному с необходимостью пересылок данных из стека в память и обратно. В принципе, эффективность MMX вызывает некоторые сомнения, так как те функции, для которых они целесообразны, с неоспоримо большим успехом выполняются графическими акселераторами, которые уже стали обыденными . К тому же для использования новых команд необходима перекомпиляция ПО. Можно предположить, что введение MMX является первой ступенью в маниакальном стремлении Intel перенести всю работу в ПК на плечи центрального процессора, получившем дальнейшее распространение в Katmai (Pentium III) в виде новых KNI (SSE)-команд (вспомним рекламу: Pentium III – новые возможности Internet, хе-хе). 
 
 

 

Pentium PRO

     Революционная вещь в своём роде. Выпущен где-то в районе 1995 года. Первые экземпляры были выполнены по 0.6 мкм BiCMOS-технологии. Тройная суперскалярная архитектура (конвейер имеет 12 уровней и поддерживает динамическое выполнение инструкций) – возможно выполнение 3-х команд за такт. Семейство процессоров Pentium Pro - это следующее поколение высокопроизводительных изделий Intel для мощных настольных компьютеров, рабочих станций и серверов. Это семейство включает в себя процессоры с тактовой частотой от 150 Mгц и выше, которые легко объединяются в многопроцессорные системы до четырех процессоров в каждой. Преимущество в производительности процессора Pentium Pro над предыдущими поколениями процессоров достигаетс за счет технологии, называемой Динамическим Исполнением. Это следующий этап развития суперскалярной архитектуры, ранее реализованной в процессорах Pentium, который позволил широко использовать трехмерную визуализацию и интерактивные возможности, необходимые для современных коммерческих и технических приложений и развивающихся приложений завтрашнего дня. Надежность и сервисные средства процессора Pentium Pro важны для наиболее ответственных приложений. 

Основные характеристики 

- Тактовая частота  ядра 150, 166, 180 и 200 Mгц

- Совместим по  кодам с приложениями, работающими с предыдущими семействами процессоров Intel

- Оптимизирован  для 32-разрядных приложений, работающих  под управлением современных  32-разрядных операционных систем

- Микроархитектура  с Динамическим Исполнением

- Единый корпус  содержит процессор Pentium Pro, кэш-память и интерфейс системной шины

- Наращивается  до четырехпроцессорной системы  с 4Гб памяти

- Раздельные  внешняя системная шина и внутренняя  полноскоростная шина кэш-памяти

- Раздельные  неблокируемая кэш-память данных  и инструкций размером 8Kб/8Kб

- Интегрированная  неблокируемая кэш-память второго  уровня 256 или 512 Kб

- Средства сохранения  целостности данных: аппаратная  коррекция ошибок (ECC), анализ ошибок  и восстановление данных, проверка  функциональной избыточности

 

4. Intel Pentium II

    Фактически  Pentium II является продолжением линейки Pentium PRO с новыми усовершенствованиями а также упрощениями, введёнными для удешевления себестоимости процессора. Эта модель появилась в 1997 году.